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具有二进制和分段结构的10位电流导向DAC的设计( Design of 10-bit current steering DAC with binary and segmented architecture )
CSL Prasanna AA Kumar
本文介绍了时钟频率为400MHz的二进制和分段结构的10位电流导向DAC的设计。本电路采用130nm工艺设计；该设计基于双端电流导向DAC拓扑结构。通过观察不同的电流单元结构，为这些结构选择最佳的电流单元。该DAC采用130nm CMOS工艺,在400MHz时钟速率下,二进制功耗为41.2mW,分段（7：3）功耗为41mW。
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