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分数n合成器和/spl δ //spl Sigma/-PLL发射机的环带宽校准系统( A loop-bandwidth calibration system for fractional-N synthesizer and /spl Delta//spl Sigma/-PLL transmitter )
Y. Akamine M. Kawabe K. Hori T. Okazaki N. Tolson M. Kasahara S. Tanaka Calibration Synthesizers Phase locked loops Transmitters Voltage-controlled oscillators Counting circuits GSM Charge pumps Filters Field programmable gate arrays
在3.3/SPL时间/3.3mm/sup2/范围内实现了一个0.25/SPL mu/m BiCMOS小数N分频锁相环。通过在瞬态阶跃响应上对VCO输出信号进行双积分，校准后的锁相环作为GSM中的a/SPLδ//SPL∑/-PLL发射机，其相位误差小于2/SPLdeg/rms，调谐精度为2%。
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